CONTACT | TEL : 02-728-3440, EMAIL : SALES@ASTRONLOGIC.COM
ASTRON LOGIC RESEARCH AND DEVELOPMENT CO.,LTD.

» WEBBOARD

เขียน VHDL เป็นวงจร Delay

คือว่าผมอยากจะเขียนVHDL เพื่อใช้งาน FPGA ทำการ Delay ข้อมูลตอนส่งข้อมูลออก Output ผมยังไม่มีแนวทางเลย พี่ๆคนไหนว่างกรุณาบอกข้อมูลหรือตัวอย่าง SoeceCode ของ VHDL เพื่อเป็นแนวทางแก่ผมด้วยนะครับ ขอบคุณมากครับ

จากคุณ : ธนากร ตั้งกระทู้นี้เมื่อ 02:00 [25/01/2005]

ร่วมด้วยช่วยกันตอบครับ
ชื่อ :
E-Mail :
คำตอบ :







คลิกเพื่อแทรกรูป